GNSS驯服铷钟的PID环路的短稳长稳权衡设计

GNSS驯服铷钟的PID环路的短稳长稳权衡设计

摘要

GNSS驯服铷钟系统依靠GNSS 1PPS作为外部时间基准，通过PID控制环路持续修正铷原子钟的输出频率偏差，实现长期频率溯源。工程设计中普遍存在一个核心矛盾：PID环路带宽、积分时间常数直接决定驯服收敛速度与抑制老化漂移的能力，但带宽过宽会引入GNSS基准噪声，劣化铷钟本身优异的短期频率稳定度；带宽过窄则驯服响应迟缓，长稳漂移得不到有效抑制。本文从铷钟噪声模型、PID环路传递特性出发，拆解PID参数对Allan方差的影响规律，分析比例、积分、微分项各自在驯服环路中的作用边界，给出兼顾短稳保留、长稳校准的参数整定思路与工程约束条件，同时说明Holdover切换逻辑与环路保护策略，结合国产工程设备实测指标说明权衡设计带来的实际性能收益，为自研驯服板卡、时统设备开发提供可落地的设计参考。

关键词：驯服铷钟，gps铷原子钟，gps驯服铷钟，高精度铷原子钟

一、GNSS驯服铷钟系统基本架构与噪声来源

GNSS驯服铷钟也常被行业称作GPS驯服铷钟，属于闭环相位/频率锁定系统：北斗/GNSS接收机输出1PPS秒脉冲作为外部参考基准，时差测量单元比对基准1PPS与铷钟分频得到的本地1PPS，输出时差误差信号送入PID控制器；PID输出控制电压施加到铷钟的压控调频端口，缓慢修正铷钟谐振频率，逐步缩小钟差。

整套系统存在两类性质完全不同的噪声源，也是短稳长稳冲突的根源。第一类是铷钟固有噪声：包含白相位噪声、白调频噪声、闪变调频噪声与随机游走调频噪声，这类噪声决定了高精度铷原子钟在秒级至百秒级的短期稳定度，是铷钟相比OCXO最核心的优势；这类噪声变化快，不适合被高带宽环路强行压制。第二类是GNSS基准链路噪声：包含接收机1PPS抖动、卫星多径效应、电离层时延波动、线缆温度时延漂移、测量电路量化噪声，这类噪声属于外部引入的慢变与随机扰动，环路的核心目标是抑制铷钟低频老化漂移，而不是跟随GNSS高频抖动。

很多新手设计误区是把驯服环路当成普通晶振锁相环，追求快速锁定、快速消差。但晶振和铷钟的动力学特性差异巨大：铷原子钟是大惯性时频源，存在原子弛豫效应，不适合大幅度、快速阶跃调频，高频跟随基准抖动会直接抹平高精度铷原子钟本身优异的短稳指标。

在实际工程样机中，同样的铷钟物理模块，搭配不同PID环路参数，最终整机输出的秒级稳定度、百秒级稳定度、24小时守时保持精度会出现明显分化。同步天下SYN3306型高性能铷原子钟在整机实现中就体现了该环路权衡思想，通过分区PI环路设计，既保留铷钟原生短稳，同时实现24小时驯服精度优于1×10⁻¹²，断星条件下24小时保持精度控制在微秒量级。

二、铷钟的噪声模型与Allan方差的物理含义

Allan方差（σy(τ)）是时频领域评价频率稳定度的标准工具，不同平滑时间τ对应的Allan方差曲线，对应不同类型噪声的主导区间：

小τ（<10 s，短期）：白调频噪声、闪变调频噪声主导，体现铷钟固有短稳；

中等τ（10 s～1000 s）：噪声趋于平缓，是铷钟稳定度优势区间；

大τ（>1000 s，长期）：随机游走调频、老化漂移项主导，这正是GPS驯服铷钟环路需要校正的分量。

PID环路本质是一个低通滤波器。环路截止频率越高，环路能够响应越快的误差信号：一方面可以更快消除铷钟低频漂移，改善长稳；另一方面环路会通过GNSS基准的高频噪声，叠加到铷钟控制端，在小τ区间抬升Allan方差，短稳恶化。环路截止频率越低，对GNSS高频噪声抑制越强，铷钟原生短稳保留越好，但对缓慢老化漂移的校正能力下降，长时间累计钟差变大，长稳指标变差。短稳、长稳，通过环路带宽形成一对此消彼长的约束关系。

国产铷钟模组典型裸机指标可以达到1×10⁻¹¹/1s、3×10⁻¹²/10s、1×10⁻¹²/100s量级，一旦环路带宽设置不合理，驯服之后1秒稳定度直接恶化数倍，看似钟差很小，实则已经丢失GPS铷原子钟的核心性能优势。

三、PID各控制项在铷钟驯服环路中的作用边界

标准PID离散控制方程如下（e(k)为当前时刻时差换算得到的频率偏差，u(k)为输出压控调节量）：

u(k) = Kp·e(k) + Ki·Σe(i) + Kd·[e(k) − e(k−1)]

三个控制项在驯服铷钟场景下的定位，和电机、电源控制有明显区别。

3.1 比例项Kp：误差即时响应，带宽的主要贡献者

比例项直接根据当前误差输出调节量。Kp增大，环路增益上升，收敛速度加快；但Kp过大时，环路增益过高，容易出现超调、震荡，同时放大GNSS随机抖动，直接破坏短稳。在铷钟驯服中，比例项一般取较小值，仅做小幅即时纠偏，不承担主要的漂移校正任务。

3.2 积分项Ki：消除稳态频偏，决定长稳抑制能力

积分项对误差做累积，用于消除铷钟固有的平均老化频偏，是整个驯服环路里负责长稳的核心。积分时间常数Ti=Kp/Ki是关键参数：积分时间常数越小，积分作用越强，环路可以更快把平均频偏拉回零点，长稳效果好；但积分作用过强，会持续累积GNSS基准里的慢变扰动，造成频率缓慢偏移，同时降低环路稳定裕度。

工程上一个核心原则：积分时间常数需要设置在铷钟优势稳定度区间之外，也就是积分滤波窗口大于闪变噪声特征时间，避免积分环节持续修正铷钟自然波动。

3.3 微分项Kd：误差趋势预判，慎用在铷钟驯服

微分项对误差的变化趋势敏感，理论上可以预判漂移趋势、抑制超调。但GNSS 1PPS存在随机尖峰抖动，差分运算会对高频噪声进行放大。绝大多数GPS驯服铷钟工程方案中，微分项要么置零，要么设置极小系数，仅在异常大偏差启动阶段短时启用；正常锁定稳态阶段一般关闭D项，避免噪声微分放大，严重劣化短稳。

小结：稳态驯服环路，本质是PI为主、D为辅甚至不用D的控制结构，不要照搬通用PID整定经验。

四、带宽权衡的工程整定策略：分区PID设计

单一固定PID参数无法同时满足快速收敛、优异短稳、强长稳校正三个目标，行业成熟方案普遍采用分区式PID，根据钟差误差大小切换参数组。

捕获区（钟差大，未收敛）：采用较大Kp、较大Ki，加快捕获，快速把钟差收敛到误差门限以内。这个阶段短稳不是优先指标，首要目标是快速入锁；同时增加压控步长限幅，防止电压突变带来铷钟弛豫瞬态频漂。

稳态锁定区（钟差小于设定阈值）：降低Kp，大幅减小Ki，拉长积分时间常数，压低环路带宽。此时环路只对极缓慢的老化漂移响应，滤除GNSS高频抖动，最大限度保留铷钟原生短稳。这是权衡设计的核心区间。

异常保护区：识别GNSS野值、断星、信号劣化，触发环路冻结，停止PID积分累加，平滑过渡到Holdover守时模式。

带宽选取经验准则：环路等效截止角频率对应的时间常数，应当远大于铷钟短稳关注的积分时间τ。例如，关注τ=1 s～100 s的Allan方差，环路积分时间常数通常设置为几千秒量级，让环路只校正千秒以上的慢漂移分量。

工程现实约束：铷钟每日老化漂移普遍处于10⁻¹¹～10⁻¹²/天量级，积分时间常数不能无限拉大，否则环路校正速度追不上铷钟自身老化漂移，长期钟差会持续累积。

五、Holdover切换与环路保护，避免驯服失效后的二次劣化

GNSS信号丢失、多径干扰剧烈时，基准1PPS不再可信，PID环路必须及时退出驯服模式。如果继续使用脏基准做积分校正，会持续把错误偏差累积到控制电压上，不仅长稳崩坏，还会引入人为频偏。

工程实现上设置两级判断：一是时差残差门限，短时误差超出阈值先屏蔽本次误差采样，不送入PID；二是连续异常计数，连续N个周期基准异常，冻结PID输出，保持当前压控电压，进入Holdover。

Holdover阶段不再使用GNSS基准，可启用预建立的铷钟老化、温度频漂预测模型，对频率漂移做外推补偿。驯服恢复时，不能立刻切回高带宽参数，采用缓启动、渐进式恢复积分，避免相位跳变冲击下游同步系统。

Holdover性能直接检验前期PID环路权衡效果：稳态阶段环路如果带宽过高，虽然驯服状态指标好看，但会把GNSS噪声带入铷钟压控端，断星之后守时漂移会额外增大；合理窄带宽PI环路下，Holdover性能主要由铷钟本身老化、温漂特性决定，整机24小时守时保持精度可以控制在1μs～1.5μs区间。

六、实测评价方法：怎么验证短稳长稳权衡是否达标

驯服铷钟的设计效果，不能只看能不能锁定、钟差是不是很小，必须用Allan方差对比验证：

分别测试环路关闭（铷钟自由运行）、宽带宽PID、窄带宽PI三组条件下的Allan方差曲线；

对比小τ段：曲线和自由铷钟接近，说明短稳保留合格；小τ明显抬升，代表环路带宽偏高，噪声灌入；

对比大τ段：宽带宽方案长稳更低（更好），但短稳代价大；窄带宽方案大τ缓慢抬升，代表老化漂移校正不足；

辅助指标：最大稳态钟差、锁定收敛时间、断星后1h/2h守时误差。

理想的权衡结果：在关注的短稳τ区间，Allan方差几乎不劣于裸铷钟；在几千秒以上长周期，漂移被有效抑制，远优于无驯服自由运行状态。

测试时还需要同步采集相位噪声指标，环路异常引入高频调制，也会直接恶化1Hz～10kHz偏移处的相位噪声水平，这也是高精度铷原子钟整机验收不可忽略的一环。

七、总结

GNSS驯服铷钟的PID环路设计核心，不是追求越快锁定越好，而是利用环路的低通滤波特性做频率分量筛选：用低频积分通道专门抑制铷钟长期老化漂移，同时隔绝GNSS基准的高频噪声，保护铷钟与生俱来的短期稳定度。

PID参数上优先采用PI结构，谨慎使用微分项；采用分区参数策略区分捕获阶段和稳态阶段；配合野值检测、积分冻结、Holdover平滑切换机制。这套权衡思路，是GPS铷原子钟、GPS驯服铷钟设备研发过程中的关键技术。实际设备指标不是单纯取决于铷钟模块本身，驯服环路参数设计往往会对高精度铷原子钟整机最终时频性能带来量级上的影响。

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